基于Vivado HLS的Sobel圖象邊緣檢測
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AXI4-Lite總線的主從機(jī)讀寫例程及代碼
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基于Xilinx FPGA的OFDM通信系統(tǒng)基帶設(shè)計
2021-10-12 869 5
視頻圖像處理的雙線性插值工程（基于FPGA）
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用于胎兒心電監(jiān)測用自適應(yīng)濾波器實現(xiàn)的Verilog代碼
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采用FPGA的DDS算法Verilog程序的實現(xiàn)
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Xilinx JTAG-SMT2全套設(shè)計資料
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基于xilinx XC7A100T開發(fā)板工程
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FPGA TCPUDP千兆以太網(wǎng)高速傳輸方案 開源UDP版工程
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基于FPGA+ARM的人臉識別智能監(jiān)控系統(tǒng)
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三相方波電源FPGA驅(qū)動代碼(測試程序)
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DE2-115 FPGA手勢識別
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基于FPGA的視頻圖像以太網(wǎng)傳輸(編譯軟件為Vivado 2017)
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實現(xiàn)PFGA CPU設(shè)計 以及l(fā)ogitsim的文件及編譯代碼
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基于FPGA平臺的實時視頻去霧系統(tǒng)項目代碼
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Verilog HDL實現(xiàn)雙線性插值視頻實時縮放
2021-10-03 875 10
用Verilog HDL實現(xiàn)Virtex-7 FPGA的CNN加速
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