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【E225】異步FIFO的純Verilog實(shí)現(xiàn)

2021-08-16 22:38:07      索煒達(dá)電子      652     

使用verilog編寫的異步fifo，讀寫端口各有一組時(shí)鐘、讀寫使能、讀寫端口、滿空指示、fifo使用量。本模塊既不可靠，也不成熟，更不實(shí)用；注釋寫得多，可以作為學(xué)習(xí)參考。

aclr：異步復(fù)位，同步釋放端口

【E225】異步FIFO的純Verilog實(shí)現(xiàn)

【E225】異步FIFO的純Verilog實(shí)現(xiàn)

文件列表：

目錄│文件列表:

 └ DC_fifo

    └ fifo.v

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